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fpga

Bonjour,

 

J'ai un CRIO avec 2 modules d'aquisition analogique.

Dans le FPGA je fait l'acquisition des 4 voies de mesure du module 1, ces 4 mesures passent par un calcule RMS.

Puis dans le RT je resort ces 4 mesures qui transitent via 4 user defined variable et je les affichent.

Là impecable !

 

Par contre quand je fait la même manip mais avec les 2 modules en même temps, le rafraichisement des données se fait genre toutes les 20 secondes..

 

Que faire?

 

Merci par avance pour votre aide 

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